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AD9889BBCPZ原装现货热销/ADI品牌代理/价格/图片/PDF 发布时间：2016/10/25 10:34:09 一般 HDMI®
/ DVI发送器与HDMI 1.3节兼容，
DVI 1节，或1.2节
单1.8伏电源
视频/音频输入接受逻辑电平从1.8 V至3.3 V
80引脚LQFP封装，无铅封装
64引脚LFCSP无铅封装，
76球csp_bga，无铅封装
数字视频
165兆赫操作支持从480i的所有决议
1080p和UXGA 60赫兹
80 MHz的衍生支持从480i的所有决议
1080i/720p视频和XGA 70赫兹
可编程双向彩色空间转换器
支持RGB、YCbCr、DDR
支持ITU656嵌入式同步
自动输入视频格式定时检测（cea-861b）
数字音频
支持标准立体声S/PDIF LPCM或压缩
音频高达192千赫
8通道，未压缩的LPCM I2S音频高达192千赫
易于系统设计的特殊功能
对I2C主执行HDCP操作芯片微处理器
与EDID读取操作
5 V宽容的I2C和HPD的I / O，无需额外的设备
没有音频主时钟支持S/PDIF需要
和I2S
通过中断和芯片微处理器报告HDMI事件
寄存器
应用
播放器和录音机
数字机顶盒
A / V接收机
数码相机和摄像机
HDMI中继器/分配器
一般描述
该AD9889B是一个165 MHz的高清晰度多媒体接口
（HDMI）1.3节发射机。它支持HDTV格式了
1080P，和计算机图形分辨率高达UXGA（1600×
1200在60赫兹）。与HDCP的夹杂物，AD9889B允许的
由所指定的受保护内容的安全传输
HDCP 1.2节协议。
该AD9889B支持S/PDIF和8路I2
的音频。
其保真度高，8路I2
S可以传输立体声或7.1
环绕音频在192千赫。的S / PDIF可以携带立体声LPCM
音频或压缩的音频，包括DTS®，谢谢®，和多尔比®
数字。
该AD9889B有助于降低系统设计的复杂性和成本
通过将这些特征作为HDCP内部微处理器
操作，I2
C掌握EDID读取，1.8 V单电源
供应，和5 V宽容的I2
C和热插拔检测引脚。
在先进的CMOS工艺制造，AD9889B是的
在一个节省空间的使用，76球csp_bga或64引脚LFCSP
表面贴装封装和80引脚LQFP表面贴装
包裹.所有的包都是免费的，并指定
从−25°C + 85°C.
PCB布局建议
该AD9889B是一种高精度、高速度的模拟装置。作为
这样，从一部分获得最大的性能，它是
重要的是有一个良好的布局板。
电源旁路
建议用一个旁路来旁路每一个电源引脚
0.1µμF的电容。例外是当两个或两个以上的供应
引脚是彼此相邻的。对于这些集团
权力/理由，它是必要的只有一个旁路
电容器.其基本思想是有一个旁路电容器
在约0.5厘米的每个电源引脚。此外，避免放置
电容器的对面的PC板从
AD9889B，作为设置电阻通路的路径。
旁路电容应在物理位置
电源平面和电源引脚。电流应该从
电源平面到电容器的电源引脚。不做
电容器和电源引脚之间的电源连接。
放置一个通过下面的电容垫，下降到电源
平面上，一般是最好的方法。
保持低噪声和良好的是特别重要的
稳定性PVDD（PLL电源）。在PVDD的突然变化
也可能导致采样时钟相位的类似的突然变化
和频率。这可以通过仔细注意避免
调节，滤波和旁路。提供最好的实践
用于模拟电路的每个单独的调节电源
组（AVDD和PVDD）。
它也被推荐使用一个单一的地面平面
整个董事会。经验一再表明
噪声性能是相同或更好的一个单一的
接地平面。使用多个接地飞机可能是有害的
因为每一个单独的地平面较小，并且
长的接地回路可能会导致。
数字输入
视频和音频数据输入信号
在AD9889B数字输入的设计工作
信号范围从1.8 V到3.3 V逻辑电平。因此，没有
使用3.3 V逻辑时，需要添加额外的组件。
任何噪声，获取到的时钟输入（标记为CLK）微量
向系统中添加抖动。因此，尽量减少视频时钟
输入（引脚6：CLK）迹长和不运行任何数字或
其他高频附近的痕迹。请确保匹配
输入数据信号的长度，以优化数据采集，
特别是对于如1080P、UXGA高频率模式，和
双数据速率输入格式。
其他输入信号
HPD必须连接到HDMI连接器。10 KΩ
下拉电阻到地还建议。
钯/ A0输入引脚可以连接到GND或供应
（通过一个电阻或一个控制信号）。设备地址和
关闭电源的极性是由国家的钯/ A0引脚时
该AD9889B供应应用/功能。例如，如果
钯/ A0引脚是低（当电源打开），然后
设备地址的0x72和掉电活性高。如果
钯/ A0引脚为高（当电源接通），该装置
地址是0x7a和掉电活性低。
SCL和SDA引脚应该连接到I2
C主。
上拉电阻2 KΩ1.8 V或3.3 V的建议
外摆电阻
外部摆动电阻必须直接连接到
ext_swg引脚和地。外部摆动电阻必须
有一个价值887Ω（±1%耐）。避免运行任何高
速交流或嘈杂的信号下，或接近的ext_swg销。
输出信号
TMDS信号输出
有三的AD9889B TMDS数据通道（0，1，2），
输出信号高达800 MHz以及TMDS输出数据
时钟。为了尽量减少通道到通道偏移，使
这些信号的跟踪长度相同。此外，这些痕迹
需要有一个50Ω特性阻抗和需
100Ω差分对路由。最佳实践建
这些线路的路由上的PCB层避免使用过孔。
其他的输出信号（非TMDS）
ddcscl和DDCSDA
的ddcscl和ddcsda输出需要有一个最低的
电容负载量，以确保最佳的信号完整性。
的ddcscl和ddcsda电容负载必须少
超过50 pF的满足HDMI符合性规范。这个
ddcscl和DDCSDA必须连接到HDMI
连接器和一个上拉电阻需要5 V。上拉
电阻必须有一个1.5 K和2 KΩΩ之间的值。
INT引脚
INT引脚输出应连接到微控制器
该系统。上拉电阻的1.8 V或3.3 V
正确的操作需要的推荐值为2 KΩ。
MCL和MDA
MCL和MDA的输出应连接到
含有HDCP密钥的EEPROM（如果HDCP的实现）。
拉了2 KΩ电阻推荐。
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