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 EP1AGX50DF1152I6N EP1AGX35DF780I6N EP1AGX50CF484C6N EP1AGX50DF1152C6N EP2AGX125EF29I6N EP2AGX95EF35I6N EP2A40B724I9N EP2A40F1020I8N EP2A40F672I8N EP2A25F672I8N EP2A25B724I7N EP2A15FF672I8N EP2A15B724I7N EP2A15F672I8N EP2AGX95EF35C6N EP2AGX125EF35C5N EP2A40B724C9N EP2A40F1020C8N EP2A40F672C8N EP2A25F672C8N EP2A25B724C7N EP2A15FF672C8N EP2A15B724C7N EP2A15F672C8N EP4SE530F40I3N EP4SE290H29I2N EP4SE290F40I2N EP4SE680H35I3N EP4SE680F43I3N EP4SE680F40I3N EP4SE360H29I2N EP4SE360F40I2N EP4SE290F35I2N EP4SE230F29I2N EP4SE110F29I2N EP4SGX530NF45I2N EP4SGX530KH40I2N EP4SGX530HH35I2N EP4SGX230KF40I2N EP4SGX230HF35I2N |
EPM7256AETC144-7N原装现货热销/Altera品牌代理/价格/图片/PDF 发布时间：2016/4/21 13:42:58 高性能3.3V EEPROM基于可编程逻辑 器件（PLD）建立在第二代多阵列矩阵
（最大®）结构（见表1）
■3.3V的在系统可编程（ISP）通过内置
IEEE 1149.1标准的联合测试行动小组（JTAG）接口
先进的销锁定能力
–最大7000ae装置在系统可编程（ISP）电路
符合IEEE 1532标准
–epm7128a和epm7256a器件ISP电路兼容
IEEE 1532标准
■建在边界扫描测试（BST）电路兼容
IEEE 1149.1标准
■支持JEDEC标准测试和编程语言的果酱
（配）jesd-71
■ISP功能增强
–提高ISP算法更快的编程（不包括
epm7128a和epm7256a设备）
–isp_done点确保完整的编程（不包括
epm7128a和epm7256a设备）
在系统编程时，拉上电阻
■引脚与流行的5.0 - V MAX 7000S设备兼容
■高密度可编程逻辑器件的范围从600到10000可用门
■扩展温度范围
4.5-ns引脚到引脚的逻辑延迟计数器频率高达
227.3兆赫
■multivolttm I/O接口使设备的核心运行在3.3 V，而
的I / O引脚兼容5.0 - V，3.3 V和2.5 V的逻辑电平
■引脚数从44到256的各种薄型四方扁平封装
（TQFP），塑料四方扁平封装（PQFP），球栅阵列（BGA），节省空间
科菱bgatm，塑性J形引线芯片载体（PLCC）
包
■支持最大7000ae设备热插拔
■可编程互连阵列（PIA）连续路由结构
对于快速，可预测的性能
■PCI兼容
■总线友好的架构，包括可编程的摆率控制
■开漏输出选项
■可编程宏单元寄存器与个人明确，预设，
时钟，时钟使能控制
■可编程电源状态寄存器中的宏
最大7000ae设备
■可编程省电模式50%或更大的权力
每个宏单元还原
■配置扩展乘积项分配，允许了
32个宏单元产品条款
■可编程安全点的专有设计保护
■6至10针或逻辑驱动输出使能信号
■两全局时钟信号与可选的反演
■增强改进路由互连资源
■快速输入设置时间由一个专用的路径从I/O引脚
宏单元寄存器
■可编程输出摆率控制
■可编程的接地引脚
软件设计支持和自动所提供的位置和路线
基于Windows的PC和太阳Altera公司的开发系统
SPARC工作站，HP 9000系列700 / 800工作站
■额外的设计输入和仿真研究提供的支持
2 0 0 3 0 0的网表文件，参数模块库（LPM），
Verilog HDL，VHDL，和其他流行的EDA工具接口
厂商如Cadence，Mentor Graphics的典范逻辑，
OrCAD，Synopsys，Synplicity、和程序
以Altera公司的主程序单元■编程支持
（MPU）、MasterBlasterTM串行/通用串行总线（USB）
通信电缆，ByteBlasterMVTM并口下载
电缆和BitBlasterTM串口下载线，以及
从第三方制造商和任何
jamtm STAPL文件（。果酱），果酱的字节码文件（。JBC），或串行矢量
格式文件（。SVF）电路测试器
一般
描述
最大7000A（包括最大7000ae）器件的高密度、高性能
基于Altera公司的第二代最大的设备
建筑。先进的CMOS技术制造，该eeprombased
最大7000A器件采用3.3 V电源电压
提供600至10000可用门，ISP，引脚到引脚的延迟为4.5纳秒的速度，
和计数器的速度高达227.3兆赫。最大7000A器件在- 4 - 5，
- 6，- 7，和一些- 10的速度等级是兼容的时间
33兆赫特殊利益集团（经皮冠状动脉介入治疗术的操作要求
SIG）PCI局部总线规范，修订2.2。见表2。
最大7000A架构支持100%晶体管-晶体管逻辑
（TTL）SSI、MSI仿真和高密度集成，和LSI逻辑
功能。它很容易集成包括朋友，女孩多个设备，和
22v10s设备。最大7000A器件在很宽的范围内可
包，包括PLCC，BGA，FineLine BGA，超FineLine BGA，
PQFP，和TQFP封装。见表3和表4。
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