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MPC8548CVTAUJB原装现货热销/Freescale品牌代理/价格/图片/PDF 发布时间：2015/7/29 10:06:54 概观 本节提供MPC8548E的高层次概述
产品特点。图1示出了内部的主要功能单元
MPC8548E的。
虽然本文件从的角度来写
的MPC8548E，大部分材料适用于其它
家族成员，如MPC8547E，MPC8545E，和
MPC8543E。当具体差异出现，如引出线
差异和处理器的频率范围，它们是
确定为这样。
对于具体的PVR和SVR的号码，请参考MPC8548E
III的PowerQUICC集成处理器系列参考
手册。
主要特点
下面的列表提供了MPC8548E功能集的概述：
•基于PowerArchitecture®技术的高性能32位内核。
- 32 KB的L1指令缓存和奇偶校验保护32 KB的L1数据缓存。缓存可以
是锁定完全或基于每个线的基础上，对指令和数据分开的锁定。
- 信号处理引擎（SPE）的APU（辅助处理单元）。提供了一个广泛
指令矢量（64位）整数和分数的操作进行设置。这些指令同时使用
64位GPR组成上下话，因为它们是由在SPE APU限定。
- 双精度浮点APU。提供指令，用于双精度（64位）中设置
浮点使用64位的GPR的指令。
- 36位寻址实
- 嵌入式矢量和标量单精度浮点的APU。提供的指令集
对于单精度（32位）浮点指令。
- 内存管理单元（MMU）。专门设计用于嵌入式应用。支撑
4千字节到4 GB的页面大小。
- 增强的硬件和软件调试支持
该E500定义未在该设备上实现的功能。它也通常定义了一些功能
该设备实现了更具体。这些差异的理解可以对关键
确保正确的操作。
•512 KB的L2高速缓存/ SRAM
- 灵活配置。
- 全面ECC支持在64位边界在这两个高速缓存和SRAM模式
- 缓存模式支持的指令缓存，数据缓存，或两者兼而有之。
- 外部主人可以强制数据通过编程内存分配到高速缓存
范围或特殊交易类型（藏起来）。
- 1，2，或4的方法可被配置为仅积攒。
- 八 - 路组相联高速缓存组织（32字节的高速缓存行）
- 支持锁定整个缓存或选定行。个别行锁设置，并通过清除
Book电子指令或通过外部掌握交易。
- 全球锁和Flash做结算通过写入L2配置寄存器
- 指令和数据锁可分别闪存清除。
- SRAM功能包括以下内容：
- I / O设备访问SRAM地区按标记为可窥探（全球）交易。
- 区域可以驻留在内存映射对齐的任何位置。
- 字节访问的ECC使用的读 - 修改 - 写事务访问保护
小超高速缓存行的访问。
•地址转换和映射单元（通邮）
- 八个本地访问窗口定义本地36位地址空间内的映射。
- 入站和出站ATMUs映射到较大的外部地址空间。
- 三入站窗户加了配置窗口上的PCI / PCI-X和PCI Express
- 四入站窗加上的RapidIO™默认的窗口
- 四出境窗户加默认翻译PCI / PCI-X和PCI Express
- 八出境窗户加上默认翻译与RapidIO的分割和
子分段支持
•DDR / DDR2内存控制器
- 可编程定时支持DDR和DDR2 SDRAM
- 64位数据接口
- 四银行存储器支持，每个多达4千兆字节，最大为16千兆字节
- 从64兆到4千兆位的DRAM芯片配置，×8/16×数据端口
- 全面支持ECC
- 页模式支持
- 多达16个打开的页面用于DDR
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