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EP1AGX50DF1152I6N
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EPM1270T144C5N原装现货热销/Altera品牌代理/价格/图片/PDF 发布时间:2015/5/15 11:19:54 本节为设计师提供的数据表规格 MAX®II器件。该章节包含内部的功能定义
架构,联合测试行动组(JTAG)和在系统
编程(ISP)的信息,直流工作条件,AC时机
参数和MAX II器件的订购信息。
本部分包括以下内容:
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第1章简介
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第2章MAX II架构
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第3章JTAG和在系统可编程
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第4章热插拔和上电复位MAX II器件
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第5章直流和开关特性
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第6章参考和订购信息
修订历史
请参阅各章自己特定的修订历史记录。有关信息
就当每个章节进行了更新,请参阅章修订日期
部分,它出现在完整的手册。
该MAX®II系列瞬时上电,非易失性CPLD产品是基于
0.18微米,6层金属Flash工艺,具有密度从240至2,210个
逻辑单元(LE)(128~2210当量宏小区)和非易失性
存储8千位。 MAX II器件提供高I / O数量,速度快
性能和可靠嵌合相对于其他的CPLD架构。
拥有多电压™内核,用户闪存(UFM)块,和
增强在系统编程(ISP),MAX II器件的设计
以降低成本和功耗,同时提供的可编程解决方案
应用,如总线桥接,I / O扩展,上电复位(POR)
和顺序控制和设备配置控制。
低成本,低功耗CPLD
■
瞬时上电,非易失性架构
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待机电流低至2毫安
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提供快速传播延迟和时钟到输出时间
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提供了四个全局时钟有两个时钟提供每个逻辑阵列
模块(LAB)
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UFM方框高达8 Kbits的非易失性存储
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多电压内核使外部电源电压的装置
无论是3.3 V / 2.5 V或1.8 V
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多电压I / O接口,支持3.3 V,2.5 V,1.8 V,1.5-V逻辑
水平
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总线型架构,包括可编程转换速率,驱动器
强度,总线保持和可编程上拉电阻
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施密特触发器能够容忍噪声输入(每可编程
PIN)
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完全符合外围部件互连特别
兴趣小组(SIG PCI)PCI本地总线规范,修订版2.2
在66 MHz的3.3-V操作
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支持热插拔
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内置联合测试行动组(JTAG)边界扫描测试(BST)
电路符合IEEE标准。 1149.1-1990
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ISP电路,符合IEEE标准。 1532
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